rename makefiles | move verilog rule to common.mk
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abejgonzalez
parent
eb44ae13d4
commit
8b899c519d
136
Makefrag
136
Makefrag
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@ -1,136 +0,0 @@
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# set default shell for make
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SHELL=/bin/bash
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# variables to get all *.scala files
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lookup_scala_srcs = $(shell find $(1)/ -iname "*.scala" 2> /dev/null)
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PACKAGES=rocket-chip testchipip
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SCALA_SOURCES=$(foreach pkg,$(PACKAGES),$(call lookup_scala_srcs,$(base_dir)/generators/$(pkg)/src/main/scala)) $(call lookup_scala_srcs,$(base_dir)/src/main/scala)
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# rocket and testchipip classes
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ROCKET_CLASSES ?= "$(ROCKETCHIP_DIR)/target/scala-$(SCALA_VERSION_MAJOR)/classes:$(ROCKETCHIP_DIR)/chisel3/target/scala-$(SCALA_VERSION_MAJOR)/*"
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TESTCHIPIP_CLASSES ?= "$(TESTCHIP_DIR)/target/scala-$(SCALA_VERSION_MAJOR)/classes"
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# jar creation variables and rules
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FIRRTL_JAR ?= $(ROCKETCHIP_DIR)/lib/firrtl.jar
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# this should match whatever the commonSettings version is in build.sbt
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BARSTOOLS_VER=1.0
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TAPEOUT_JAR=$(base_dir)/tools/barstools/tapeout/target/scala-$(SCALA_VERSION_MAJOR)/tapeout-assembly-$(BARSTOOLS_VER).jar
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MACROCOMPILER_JAR=$(base_dir)/tools/barstools/macros/target/scala-$(SCALA_VERSION_MAJOR)/barstools-macros-assembly-$(BARSTOOLS_VER).jar
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$(FIRRTL_JAR): $(call lookup_scala_srcs, $(ROCKETCHIP_DIR)/firrtl/src/main/scala)
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$(MAKE) -C $(ROCKETCHIP_DIR)/firrtl SBT="$(SBT)" root_dir=$(ROCKETCHIP_DIR)/firrtl build-scala
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mkdir -p $(dir $@)
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cp -p $(ROCKETCHIP_DIR)/firrtl/utils/bin/firrtl.jar $@
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touch $@
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$(TAPEOUT_JAR): $(call lookup_scala_srcs, $(base_dir)/tools/barstools/tapeout/src/main/scala)
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cd $(base_dir) && $(SBT) "tapeout/assembly"
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$(MACROCOMPILER_JAR): $(call lookup_scala_srcs, $(base_dir)/tools/barstools/macros/src/main/scala) $(call lookup_scala_srcs, $(base_dir)/tools/barstools/mdf/scalalib/src/main/scala)
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||||
cd $(base_dir) && $(SBT) "barstools-macros/assembly"
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.PHONY: jars
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jars: $(MACROCOMPILER_JAR) $(TAPEOUT_JAR)
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# tapeout and macrocompiler commands
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TAPEOUT ?= java -Xmx8G -Xss8M -cp $(ROCKET_CLASSES):$(TESTCHIPIP_CLASSES):$(TAPEOUT_JAR)
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MACROCOMPILER ?= java -Xmx8G -Xss8M -cp $(ROCKET_CLASSES):$(TESTCHIPIP_CLASSES):$(MACROCOMPILER_JAR)
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# create simulation args file rule
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$(sim_dotf): $(SCALA_SOURCES) $(FIRRTL_JAR)
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cd $(base_dir) && $(SBT) "runMain example.GenerateSimFiles -td $(build_dir) -sim $(sim_name)"
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# create firrtl file rule and variables
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CHISEL_ARGS ?=
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$(FIRRTL_FILE) $(ANNO_FILE): $(SCALA_SOURCES) $(sim_dotf)
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mkdir -p $(build_dir)
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cd $(base_dir) && $(SBT) "runMain $(PROJECT).Generator $(CHISEL_ARGS) $(build_dir) $(PROJECT) $(MODEL) $(CFG_PROJECT) $(CONFIG)"
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# create verilog files rules and variables
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REPL_SEQ_MEM = --repl-seq-mem -c:$(MODEL):-o:$(SMEMS_CONF)
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$(VERILOG_FILE) $(SMEMS_CONF): $(FIRRTL_FILE) $(ANNO_FILE) $(TAPEOUT_JAR)
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$(TAPEOUT) barstools.tapeout.transforms.GenerateTop -o $(VERILOG_FILE) -i $(FIRRTL_FILE) --syn-top $(TOP) --harness-top $(MODEL) -faf $(ANNO_FILE) $(REPL_SEQ_MEM) -td $(build_dir)
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||||
$(HARNESS_FILE): $(FIRRTL_FILE) $(ANNO_FILE) $(TAPEOUT_JAR)
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||||
$(TAPEOUT) barstools.tapeout.transforms.GenerateHarness -o $(HARNESS_FILE) -i $(FIRRTL_FILE) --syn-top $(TOP) --harness-top $(MODEL) -faf $(ANNO_FILE) -td $(build_dir)
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||||
# This file is for simulation only. VLSI flows should replace this file with one containing hard SRAMs
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$(SMEMS_FILE): $(SMEMS_CONF) $(MACROCOMPILER_JAR)
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$(MACROCOMPILER) barstools.macros.MacroCompiler -n $(SMEMS_CONF) -v $(SMEMS_FILE) --mode synflops
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# run assembly/benchmarks rules
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$(output_dir)/%: $(RISCV)/riscv64-unknown-elf/share/riscv-tests/isa/%
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mkdir -p $(output_dir)
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ln -sf $< $@
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$(output_dir)/%.run: $(output_dir)/% $(sim)
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$(sim) +max-cycles=$(timeout_cycles) $< && touch $@
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$(output_dir)/%.out: $(output_dir)/% $(sim)
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$(sim) +verbose +max-cycles=$(timeout_cycles) $< 3>&1 1>&2 2>&3 | spike-dasm > $@
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# default regression tests variables and rules
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# TODO: Remove in favor of each project having its own regression tests?
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regression-tests = \
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rv64ud-v-fcvt \
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rv64ud-p-fdiv \
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rv64ud-v-fadd \
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rv64uf-v-fadd \
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||||
rv64um-v-mul \
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||||
rv64mi-p-breakpoint \
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||||
rv64uc-v-rvc \
|
||||
rv64ud-v-structural \
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||||
rv64si-p-wfi \
|
||||
rv64um-v-divw \
|
||||
rv64ua-v-lrsc \
|
||||
rv64ui-v-fence_i \
|
||||
rv64ud-v-fcvt_w \
|
||||
rv64uf-v-fmin \
|
||||
rv64ui-v-sb \
|
||||
rv64ua-v-amomax_d \
|
||||
rv64ud-v-move \
|
||||
rv64ud-v-fclass \
|
||||
rv64ua-v-amoand_d \
|
||||
rv64ua-v-amoxor_d \
|
||||
rv64si-p-sbreak \
|
||||
rv64ud-v-fmadd \
|
||||
rv64uf-v-ldst \
|
||||
rv64um-v-mulh \
|
||||
rv64si-p-dirty
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||||
.PHONY: run-regression-tests run-regression-tests-fast run-regression-tests-debug
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||||
run-regression-tests: $(addprefix $(output_dir)/,$(addsuffix .out,$(regression-tests)))
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||||
run-regression-tests-fast: $(addprefix $(output_dir)/,$(addsuffix .run,$(regression-tests)))
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||||
run-regression-tests-debug: $(addprefix $(output_dir)/,$(addsuffix .vpd,$(regression-tests)))
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# general jar cleanup rule
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.PHONY: clean-scala
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clean-scala:
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rm -rf $(MACROCOMPILER_JAR) $(TAPEOUT_JAR)
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@ -1,79 +0,0 @@
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# makefile variables shared across multiple makefiles
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# default variables to invoke the generator
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# descriptions:
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# PROJECT = the scala package to find the MODEL in
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# MODEL = the top level module of the project
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# CONFIG = the configuration class to give the parameters for the project
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# CFG_PROJECT = the scala package to find the CONFIG class
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# TB = TODO
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# TOP = TODO
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PROJECT ?= example
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MODEL ?= TestHarness
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CONFIG ?= DefaultExampleConfig
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CFG_PROJECT ?= $(PROJECT)
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TB ?= TestDriver
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TOP ?= ExampleTop
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# path to rocket-chip and testchipip
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ROCKETCHIP_DIR = $(base_dir)/generators/rocket-chip
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TESTCHIP_DIR = $(base_dir)/generators/testchipip
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# names of various files needed to compile and run things
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long_name = $(PROJECT).$(MODEL).$(CONFIG)
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FIRRTL_FILE ?= $(build_dir)/$(long_name).fir
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ANNO_FILE ?= $(build_dir)/$(long_name).anno.json
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||||
VERILOG_FILE ?= $(build_dir)/$(long_name).top.v
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||||
HARNESS_FILE ?= $(build_dir)/$(long_name).harness.v
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||||
SMEMS_FILE ?= $(build_dir)/$(long_name).mems.v
|
||||
SMEMS_CONF ?= $(build_dir)/$(long_name).mems.conf
|
||||
sim_dotf ?= $(build_dir)/sim_files.f
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# default sbt launch command
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SCALA_VERSION=2.12.4
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SCALA_VERSION_MAJOR=$(basename $(SCALA_VERSION))
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||||
SBT ?= java -Xmx2G -Xss8M -XX:MaxPermSize=256M -jar $(ROCKETCHIP_DIR)/sbt-launch.jar ++$(SCALA_VERSION)
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# output directory for tests
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output_dir=$(sim_dir)/output
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# build output directory for compilation
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build_dir=$(sim_dir)/generated-src
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# vsrcs needed to run projects
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rocketchip_vsrc_dir = $(ROCKETCHIP_DIR)/src/main/resources/vsrc
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# sources needed to run simulators
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sim_blackboxes = \
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$(build_dir)/firrtl_black_box_resource_files.f
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sim_vsrcs = \
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$(VERILOG_FILE) \
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||||
$(HARNESS_FILE) \
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||||
$(SMEMS_FILE)
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# assembly/benchmark variables
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timeout_cycles = 10000000
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||||
bmark_timeout_cycles = 100000000
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||||
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@ -11,7 +11,7 @@ sim_dir=$(abspath .)
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# include shared variables
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||||
include $(base_dir)/Makefrag-Variables
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||||
include $(base_dir)/variables.mk
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||||
# name of simulator (used to generate *.f arguments file)
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@ -32,8 +32,8 @@ debug: $(sim_debug)
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# import other necessary rules and variables
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include $(base_dir)/Makefrag
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||||
include $(sim_dir)/Makefrag-Verilator
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include $(base_dir)/common.mk
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||||
include $(sim_dir)/verilator.mk
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# verilator build paths and file names
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@ -1,47 +0,0 @@
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# verilator installation makefrag
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# verilator version, binary, and path
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VERILATOR_VERSION=4.008
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VERILATOR_SRCDIR=verilator/src/verilator-$(VERILATOR_VERSION)
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INSTALLED_VERILATOR=$(abspath verilator/install/bin/verilator)
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# build and install our own verilator to work around versioning issues
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$(INSTALLED_VERILATOR): $(VERILATOR_SRCDIR)/bin/verilator
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||||
$(MAKE) -C $(VERILATOR_SRCDIR) installbin installdata
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||||
touch $@
|
||||
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||||
$(VERILATOR_SRCDIR)/bin/verilator: $(VERILATOR_SRCDIR)/Makefile
|
||||
$(MAKE) -C $(VERILATOR_SRCDIR) verilator_bin
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||||
touch $@
|
||||
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||||
$(VERILATOR_SRCDIR)/Makefile: $(VERILATOR_SRCDIR)/configure
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||||
mkdir -p $(dir $@)
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||||
cd $(dir $@) && ./configure --prefix=$(abspath verilator/install)
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||||
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||||
$(VERILATOR_SRCDIR)/configure: verilator/verilator-$(VERILATOR_VERSION).tar.gz
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||||
rm -rf $(dir $@)
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||||
mkdir -p $(dir $@)
|
||||
cat $^ | tar -xz --strip-components=1 -C $(dir $@)
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||||
touch $@
|
||||
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||||
verilator/verilator-$(VERILATOR_VERSION).tar.gz:
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||||
mkdir -p $(dir $@)
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||||
wget http://www.veripool.org/ftp/verilator-$(VERILATOR_VERSION).tgz -O $@
|
||||
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||||
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||||
# verilator binary and flags
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||||
VERILATOR := $(INSTALLED_VERILATOR) --cc --exe
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||||
CXXFLAGS := $(CXXFLAGS) -O1 -std=c++11 -I$(RISCV)/include -D__STDC_FORMAT_MACROS
|
||||
VERILATOR_FLAGS := --top-module $(MODEL) \
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||||
+define+PRINTF_COND=\$$c\(\"verbose\",\"\&\&\"\,\"done_reset\"\) \
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||||
+define+STOP_COND=\$$c\(\"done_reset\"\) --assert \
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||||
--output-split 20000 \
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||||
-Wno-STMTDLY --x-assign unique \
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||||
-O3 -CFLAGS "$(CXXFLAGS) -DTEST_HARNESS=V$(MODEL) -DVERILATOR"
|
||||
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|
@ -11,7 +11,7 @@ sim_dir=$(abspath .)
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|||
#########################################################################################
|
||||
# include shared variables
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||||
#########################################################################################
|
||||
include $(base_dir)/Makefrag-Variables
|
||||
include $(base_dir)/variables.mk
|
||||
|
||||
#########################################################################################
|
||||
# name of simulator (used to generate *.f arguments file)
|
||||
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|
@ -32,7 +32,7 @@ debug: $(sim_debug)
|
|||
#########################################################################################
|
||||
# import other necessary rules and variables
|
||||
#########################################################################################
|
||||
include $(base_dir)/Makefrag
|
||||
include $(base_dir)/common.mk
|
||||
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||||
#########################################################################################
|
||||
# vcs binary and arguments
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||||
|
|
@ -71,12 +71,6 @@ VCS_NONCC_OPTS = \
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|||
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||||
VCS_OPTS = -notice -line $(VCS_CC_OPTS) $(VCS_NONCC_OPTS)
|
||||
|
||||
#########################################################################################
|
||||
# helper rule to just make verilog files
|
||||
#########################################################################################
|
||||
.PHONY: verilog
|
||||
verilog: $(sim_vsrcs)
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||||
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#########################################################################################
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||||
# vcs simulator rules
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||||
#########################################################################################
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